芯来 600 系列（N、U、NX、UX）-厦门市开源芯片公共技术服务平台

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芯来 600 系列（N、U、NX、UX）

时间：2026-01-13

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简介

600系列处理器包括N600（32位）、U600（32位+MMU）、NX600（64位）和UX600（64位+MMU）四个产品系列，其中U600、UX600带MMU可以运行重型操作系统，如Linux等。它可应用于AIoT边缘计算、数据中心、网络设备和基带通信等领域。

600-SMP是600系列处理器的多核配置版本，支持SMP（Symmetrical MultiProcessing）多核模式

特性

600系列单核特性

支持 RV32 IMACFDBPKVZfh/Zcxlcz和RV64 IMACFDPBKVZfh/Zc指令集
6级变长流水线双发射，满足高性能嵌入式场景需求
支持64位AXI总线接口， 32位AHB-Lite私有外设接口，ILM / DLM接口和从接口
可配置单双精度浮点
可配置SIMD DSP扩展
支持可扩展的VPU矢量处理单元（128）
可配置指令和数据片上SRAM（ILM/DLM）w ECC
可配置指令缓存（ICache）w ECC
可配置数据缓存（DCache）w ECC
可配置MMU(SV32/SV39/SV48)
可配置PMP安全机制和TEE可信执行环境，满足系统安全需求
支持标准的JTAG和cJTAG，以及Linux/Windows调试工具
支持RISC-V标准的编译工具链，以及Linux/Windows的
图形化集成开发环境（IDE）

600系列SMP多核特性

支持可配置的多核双模特性（实时处理器与应用处理器双模式）
1~16个UX600处理器自由配置，支持同步或异步时钟时序配置，支持MOESI的多核一致性
系统接口
- 支持64/128/256/512位宽AXI协议的Cluster Memory Ports
- 支持32位AHB-Lite协议的Cluster PeripheralPorts
IOCP (I/O Coherent Ports) 支持可以配置个数的端口
支持硬件数据预取机制（Data Prefetch）
Cluster Cache
- 容量大小可配置
- Cache Line Size（64Bytes）
- 可配置周期数的Tag RAM和Data RAM
- 支持与Core内Cache为Mostly Exclusive的分配机制
- 支持可配置16路组相联结构
- 支持动态可配置Cluster Local Memory模式

600系列性能及可配置性

芯来处理器IP型号	N600	U600	NX600	UX600	600-SMP
流水线级数	6
发射	单发射	单发射	单发射	单发射	单发射
用户模式和PMP(MPU)	可配置	可配置	可配置	可配置	可配置
硬件乘除法器	可配置	可配置	可配置	可配置	可配置
硬件单/双精度浮点	可配置	可配置	可配置	可配置	可配置
指令缓存（ICache）	可配置	可配置	可配置	可配置	可配置
数据缓存（DCache)	可配置	可配置	可配置	可配置	可配置
数字信号处理（DSP）	可配置	可配置	可配置	可配置	可配置
自定义指令扩展接口（NICE）	可配置	可配置	可配置	可配置	可配置
ILM	可配置	可配置	可配置	可配置	可配置
DLM	可配置	可配置	可配置	可配置	可配置
可信执行环境（TEE）	可配置	可配置	可配置	可配置	可配置
Vector扩展	可配置	可配置	可配置	可配置	可配置
Cluster Cache	无	无	无	无	可配置
MMU	无	可配置	无	可配置	可配置
K扩展	可配置	可配置	可配置	可配置	可配置
加解密	可配置	可配置	可配置	可配置	可配置

结构图表

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